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邏輯非與

非與門是兩種基本邏輯閘之一（另一種是非或邏輯），任何其他邏輯閘都可以用它們構建。由於這種特性，非與門和非或門有時被稱為“通用門”。但是，現代積體電路並非專門由單一型別的門構建。相反，EDA 工具用於將邏輯電路的描述轉換為複雜門的網表（標準單元）或電晶體（全定製）方法。

非

非門是透過連線非與門的輸入端來製造的。由於非與門相當於與門後接非門，所以連線非與門的輸入端只留下非部分。

所需門	非與門結構
真值表 輸入 A 輸出 Q 0 1 1 0

與

與門是透過在非與門後接一個非門來製造的，如下所示。這給出了一個非非與門，即與門。

所需門	非與門結構
真值表 輸入 A 輸入 B 輸出 Q 0 0 0 0 1 0 1 0 0 1 1 1

或

如果檢查非與門的真值表或應用德摩根定律，可以看出，如果任何輸入為0，則輸出將為1。但是要成為或門，如果任何輸入為1，則輸出也必須為1。因此，如果輸入被反轉，則任何高輸入將觸發高輸出。

所需門	非與門結構
真值表 輸入 A 輸入 B 輸出 Q 0 0 0 0 1 1 1 0 1 1 1 1

非或

非或門只是一個輸出反轉的或門

所需門	非與門結構
真值表 輸入 A 輸入 B 輸出 Q 0 0 1 0 1 0 1 0 0 1 1 0

異或

異或門是透過連線四個非與門來製造的，如下所示。這實際上代表了公式：“(A 非與 (A 非與 B)) 非與 (B 非與 (A 非與 B))”。

所需門	非與門結構
真值表 輸入 A 輸入 B 輸出 Q 0 0 0 0 1 1 1 0 1 1 1 0

異或非

異或非門只是一個輸出反轉的異或門

所需門	非與門結構
真值表 輸入 A 輸入 B 輸出 Q 0 0 1 0 1 0 1 0 0 1 1 1